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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › DDS的Verilog设计及Quartus与MATLAB联合仿真
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楼主: 雨打溪风

[资料] DDS的Verilog设计及Quartus与MATLAB联合仿真

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zp_xd
发表于 2011-5-12 17:21:50 | 显示全部楼层
支持下，感谢分享~！！！！
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2004111
发表于 2011-5-12 22:43:59 | 显示全部楼层
HEN HAO HEN HAO A
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cacc
发表于 2011-6-21 19:36:29 | 显示全部楼层
Quartus_II_9.1_SP2_x86破解器
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发表于 2011-6-30 00:48:36 | 显示全部楼层
谢谢分享。
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neuhone
发表于 2011-7-3 08:45:01 | 显示全部楼层
THANKS A LOT
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发表于 2011-7-5 15:58:41 | 显示全部楼层
谢啦，楼主
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发表于 2011-7-5 19:55:58 | 显示全部楼层
verilog，tks
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发表于 2011-7-7 09:57:42 | 显示全部楼层
谢谢你的资料
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发表于 2011-9-5 23:01:41 | 显示全部楼层
谢谢分享，！！！
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bijianhu
发表于 2011-9-11 12:56:34 | 显示全部楼层
谢谢提供，支持一下。
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