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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › DDS的Verilog设计及Quartus与MATLAB联合仿真
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楼主: 雨打溪风

[资料] DDS的Verilog设计及Quartus与MATLAB联合仿真

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发表于 2010-7-15 10:01:42 | 显示全部楼层
老师说了，下载就要回复
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发表于 2010-7-15 10:50:12 | 显示全部楼层
谢谢楼主！！！
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dereek
发表于 2010-7-17 02:04:27 | 显示全部楼层
NICE~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~
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发表于 2010-11-4 23:00:18 | 显示全部楼层
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发表于 2010-11-17 16:06:12 | 显示全部楼层
先顶后看
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lhxj666
发表于 2010-11-17 16:15:56 | 显示全部楼层
谢谢分享
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发表于 2010-11-26 18:45:55 | 显示全部楼层
thank you ~~~~~~~~~~~~~~~~~~~~~~
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发表于 2010-11-26 20:07:54 | 显示全部楼层
kankan
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puyuwei
发表于 2010-11-26 21:39:04 | 显示全部楼层
看看！
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cyzhai
发表于 2010-12-24 20:24:12 | 显示全部楼层
thanks for sharing
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