在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
查看: 8950|回复: 17

[求助] Design Compiler 到IC Compiler 流程問題

[复制链接]
发表于 2010-6-21 15:13:52 | 显示全部楼层 |阅读模式

马上注册,结交更多好友,享用更多功能,让你轻松玩转社区。

您需要 登录 才可以下载或查看,没有账号?注册

x
小弟是新手, 想請教一下幾個問題
原始設計裏, 使用Verilog code設計電路,
包括一個  A_top.v  B.v C.v
而A_top.v 會包含 "多個" B.v 及"多個" C.v 的 modules (在DC裏做uniguify)


1. 先用Design Compiler, 把 A_top.v及B.v C.v放進去,
    再設定相關 clk, constraint, 之後, 引進工藝庫(set library)
    做 link, 待結束後, 存檔成 A_top_dc.v
2. 打開 ICC, 設定 search_path, library後, create new lib (Milkyway)
    之後出現問題了 : 目前是用VMware模擬Linux, 不知道是否ICC判斷Windows下
    的OS檔案系統無法lock, 請問是否要把原始檔拷貝到 Linux內, 不要放在 share folder裏 ?

icc_shell> link
  Linking design 'A_top'
  Using the following designs and libraries:
  --------------------------------------------------------------------------
  * (76 designs)              /mnt/hgfs/vmshared/A_top_only/A_top.db, etc
  fast (library)              /mnt/hgfs/vmshared//syn_dc/core/fast.db
  slow (library)              /mnt/hgfs/vmshared/syn_dc/core/slow.db
Info: Creating auto CEL.
WARNING : Could not create cell lock file, giving up. Pleae check the link command
发表于 2010-6-22 03:38:13 | 显示全部楼层
发表于 2010-6-22 09:52:46 | 显示全部楼层
把原始檔拷貝到 Linux內, 不要放在 share folder裏
发表于 2010-7-11 21:38:04 | 显示全部楼层
谢谢好东西 分享啊
发表于 2011-5-11 15:53:06 | 显示全部楼层
ICC  难学不··
发表于 2011-5-18 04:34:40 | 显示全部楼层
谢谢分享啊
发表于 2011-8-26 21:35:37 | 显示全部楼层
hen  hao
发表于 2011-10-13 13:26:44 | 显示全部楼层
多謝分享囉!!
发表于 2011-12-25 21:38:11 | 显示全部楼层
bu shi ahe yoer
发表于 2013-11-29 17:38:57 | 显示全部楼层
感謝溜
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条


小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-22 16:22 , Processed in 0.026136 second(s), 9 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表