为什么电源电压越高，输出电压越低？

confiope · 发表于 2010-4-16 17:04:50

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设计了一个LDO，看到一个非常奇怪的现象，
电源电压2.5时，输出电压1.6544，FB电压0.549V
电源电压5V时，输出电压反而是1.6423V，FB电压0.552V，
负载电阻一样，
这个现象很很奇怪，
通常情况下，电源电压越高，基准越高，反馈电压越高，输出电压越高。

但是流片的结果太匪夷所思了

bettersilicon · 发表于 2010-4-16 17:18:22

“通常情况下，电源电压越高，基准越高，反馈电压越高，输出电压越高” 这个结论是怎么来的？

confiope · 发表于 2010-4-16 17:37:22

“通常情况下，电源电压越高，基准越高，反馈电压越高，输出电压越高” 这个结论是怎么来的？
bettersilicon 发表于 2010-4-16 17:18

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通常情况都是这样，输出对电源有一定的增益。

confiope · 发表于 2010-4-16 17:40:00

我的电路仿真也是这样的

zizzbear · 发表于 2010-4-16 20:28:00

你的reference 电压怎么样了？

sijutann · 发表于 2010-4-17 03:40:23

PSRR 不太好

woodtrain · 发表于 2010-4-17 09:36:23

貌似reference没怎么动，运放增益随Vdd升而下降了

123231 · 发表于 2010-4-17 10:27:13

2# bettersilicon

应该是你的PSRR没有设计好，再说LDO设计需要的是低压工作，输入输出之间的压差越低，得到的效率越高。5V的电源电源电压是很高的，你应该把2.5V的电压和1.8V的比较。

elvan · 发表于 2010-4-17 12:42:56

第一，看看你的基准是否工作正常？不应该随电源变化而变化的；
第二，看看你的输出级的OP的PSRR，是不是增益不够导致输出误差？
第三，看看你输出MOS管的工作区。

感觉是设计的问题。。。。

ddrr · 发表于 2010-4-17 16:45:05

万用表测量误差吧

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