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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Verilog HDL程序设计实例详解(光盘)
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楼主: jiemizhe

[资料] Verilog HDL程序设计实例详解(光盘)

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发表于 2012-5-17 17:04:27 | 显示全部楼层
xiexie  ....
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发表于 2012-5-17 20:00:18 | 显示全部楼层
感谢啊，好书。
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loweo
发表于 2012-5-18 15:07:34 | 显示全部楼层
谢谢楼主的分享！
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tomzhuo
发表于 2012-7-24 13:58:27 | 显示全部楼层
看一看这个
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发表于 2012-7-24 15:59:32 | 显示全部楼层
谢谢楼主
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发表于 2012-7-24 16:04:36 | 显示全部楼层
fdghdhdfgh
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发表于 2012-7-24 16:19:09 | 显示全部楼层
先顶再说
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发表于 2012-7-24 16:23:29 | 显示全部楼层
ggggggggggggggggggggggggggggggggggggggggggggggggggggggggggggggggggggg
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发表于 2012-7-24 18:13:58 | 显示全部楼层
楼主，下载了，但是怎么看啊？哪个文件用什么打开啊
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ycs3317
发表于 2012-8-20 20:31:23 | 显示全部楼层
谢谢啊！！
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