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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Verilog HDL程序设计实例详解(光盘)
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楼主: jiemizhe

[资料] Verilog HDL程序设计实例详解(光盘)

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发表于 2013-3-12 14:28:42 | 显示全部楼层
看一看！谢谢！
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发表于 2013-3-23 10:24:52 | 显示全部楼层
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发表于 2013-3-23 10:29:42 | 显示全部楼层
不错，下来看看
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zww_ee
发表于 2013-3-24 15:06:24 | 显示全部楼层
还不错，看看
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decaden
发表于 2013-3-24 15:16:01 | 显示全部楼层
楼主好人！！！
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lexie
发表于 2013-3-24 15:43:03 | 显示全部楼层
谢谢楼主分享
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Mr_Stone
发表于 2013-3-25 12:11:05 | 显示全部楼层
看看
好东西
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发表于 2013-3-26 15:38:09 | 显示全部楼层
不错，下来看看！
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发表于 2013-4-8 21:16:40 | 显示全部楼层
谢谢楼主分享
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发表于 2013-6-10 16:25:30 | 显示全部楼层
有劳了，估计可以少敲一些代码了。
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