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[资料] DDS 大全 信号发生器

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发表于 2010-3-17 11:50:47 | 显示全部楼层 |阅读模式

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DDS 大全  信号发生器

正弦信号发生器.pdf

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DDS的FPGA实现.pdf

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DDS技术在正弦信号发生器中的应用.pdf

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DDS数字移相正弦信号发生器的设计.pdf

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DDS信号源的FPGA实现.pdf

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DDS原理及其应用.pdf

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Sear.pdf

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基于CPLD的高精度任意波形发生器的研制.pdf

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基于DDS的BOC(m,n)信号发生器及其FPGA实现.pdf

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基于DDS的宽带信号源的设计与实现.pdf

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基于DDS技术的BPSK信号生成.pdf

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基于DDS技术的多路同步信号源的设计.pdf

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基于DDS技术的交流信号发生器设计与实现.pdf

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基于DDS技术的可调高精度信号源设计.pdf

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基于DDS驱动PLL结构的宽带频率合成器设计.pdf

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基于FPGA的高速DDS设计与仿真.pdf

251.29 KB, 下载次数: 57 , 下载积分: 资产 -2 信元, 下载支出 2 信元

基于SOPC的DDS函数发生器的设计.pdf

163.4 KB, 下载次数: 30 , 下载积分: 资产 -2 信元, 下载支出 2 信元

可控放大器的设计与应用.pdf

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一种高速DDS结构及其FPGA实现.pdf

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用AVR单片机制作DDS信号源.pdf

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发表于 2010-3-17 13:19:12 | 显示全部楼层
为什么不压缩呀??????哎,想下,可没钱!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!
发表于 2010-4-20 16:39:36 | 显示全部楼层
把控制放大器拿走学习下,谢谢楼主
发表于 2010-4-22 22:09:01 | 显示全部楼层
谢谢分享
发表于 2010-4-25 23:17:39 | 显示全部楼层
呵呵呵,,挺多的!!!
发表于 2010-4-26 13:44:21 | 显示全部楼层
DDS我还没搞清楚是啥。。。
发表于 2010-5-16 15:03:13 | 显示全部楼层
推荐一款业内时钟频率最高的DDS芯片,特点如下:
KEY FEATURES
• 32-bit frequency tuning word
• 13-bit ROM phase address resolution
• On chip DAC with 11 bit linearity
• Clock rate up to 3.2 GHz
• Sine wave generation up to 1.6 GHz
• Complementary analog waveform outputs with 50 Ω back terminations
• Carry bit RF output from phase accumulator for synchronization triggering of testing scope
or system applications
• Worst SFDR > 45 dBc (DC to 1.6-GHz Bandwidth) at a 3.2 GHz clock rate
• LVTTL/CMOS digital pattern control input
• Reset (RST) pin to initiate phase 0 starting state
• High speed strobe inputs (STR_P/N) to update the frequency word and DAC output
frequency
• High speed strobe inputs allow IT to be controlled by micro-controller or DSP chips
for real time chirping function
• Frequency update rate as fast as 8 clock cycles
• 3.5 W power consumption with a single -5V power supply
• 64-pin QFN package
发表于 2010-5-25 11:08:44 | 显示全部楼层
全,很好很强大
发表于 2010-5-25 14:52:47 | 显示全部楼层
thanks for sharing
发表于 2010-5-30 20:22:36 | 显示全部楼层
好多呀,可惜没钱下
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