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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › 数字频率计的设计（verilog)
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楼主: huige2601

[原创] 数字频率计的设计（verilog)

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superhan666
发表于 2010-6-21 21:03:33 | 显示全部楼层
先看懂再说
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superhan666
发表于 2010-6-21 21:05:54 | 显示全部楼层
如果能用数码管显示就好了
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yuanshiluoji
发表于 2010-7-28 21:55:20 | 显示全部楼层
学习咯
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yuanshiluoji
发表于 2010-7-28 22:02:46 | 显示全部楼层
学习啦
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cdyywz
发表于 2010-7-30 00:23:23 | 显示全部楼层
学习了....
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liuning0041
发表于 2010-8-9 21:27:05 | 显示全部楼层
1# huige2601
很有用
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ismy2009
发表于 2010-8-10 20:06:06 | 显示全部楼层
不错，感谢分享
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saiter1
发表于 2010-8-11 06:56:00 | 显示全部楼层
下来看看  顶上去先
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东北人儿
发表于 2010-8-11 10:20:33 | 显示全部楼层
DDDDDDDDDDDDDDDDDDDD
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raymond1989
发表于 2010-8-11 22:59:29 | 显示全部楼层
谢谢楼主！
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