设为首页收藏本站

eetop公众号

创芯大讲堂

创芯人才网

切换到宽版

手机号码，快捷登录

创芯云服务 : 创芯大讲堂 | 创芯人才网 | 数字IC职业培训 EETOP诚邀线上IC培训讲师!

搜帖子

EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › FPGA时序约束

发新帖

查看: 2152|回复: 6

[资料] FPGA时序约束

发表于 2010-1-27 14:29:27 | 显示全部楼层 |阅读模式

马上注册，结交更多好友，享用更多功能，让你轻松玩转社区。

您需要登录才可以下载或查看，没有账号？注册

x

想成为FPGA高手的进来看看

相关帖子

回复

发表于 2010-1-27 15:28:19 | 显示全部楼层

东西呢啊

EETOP创芯人才网简历投递入口

回复支持反对

发表于 2010-1-27 16:33:18 | 显示全部楼层

没东西？？

回复支持反对

发表于 2010-1-27 17:26:47 | 显示全部楼层

进来了，
Yeah，我已经是高手了！
顺便问一下，FPGA是什么？

回复支持反对

发表于 2010-1-27 21:52:59 | 显示全部楼层

没东西啊。。。

EETOP创芯人才网简历投递入口

回复支持反对

发表于 2010-6-10 21:09:52 | 显示全部楼层

没东西呀

EETOP创芯人才网职位发布入口

回复支持反对

发表于 2010-11-30 13:20:55 | 显示全部楼层

~~~~~~~~~~~~

EETOP创芯人才网简历投递入口

回复支持反对

发新帖

高级模式

B Color Image Link Quote Code Smilies

您需要登录后才可以回帖登录 | 注册

本版积分规则回帖后跳转到最后一页

关闭

站长推荐 /1

小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号京公网安备:11010502037710 )

GMT+8, 2024-11-19 00:52 , Processed in 0.024142 second(s), 8 queries , Gzip On, Redis On.

eetop公众号

创芯大讲堂

创芯人才网

快速回复 返回顶部 返回列表