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KT胡运旺

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1.Minimum 4 year experience in the hands-on IC verification with coverage driven testing methodology.
2.Be familiar with System Verilog.  Familiarity of Synopsys VMM or Cadence Plan-to-Closure Methodology.
3.Be familiar with ARM process and AHB, AXI protocol.
4.Knowledgeable in ASIC design methodology

工作地点：上海

公司有非常强的系统厂家的支持，而系统厂家又有非常强的背景，此公司的发展前景应该是非常不错。

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