"Clk" is an undefined clock 这是什么回事？

phany · 发表于 2009-12-18 16:07:43

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Info: Assuming node "Clk" is an undefined clock，碰到这种警告怎么处理，如果不处理会有什么影响？

s0lar · 发表于 2009-12-18 17:50:18

没有添加时钟的定义？

syncom · 发表于 2009-12-18 18:34:14

可能是"Clk"這pin是有接到DFF 的Clk,
但你的timing constraint 沒有define...

linuxluo · 发表于 2009-12-20 15:07:59

什么工具什么命令产生？

foreveryanyee · 发表于 2009-12-20 16:57:52

综合时出现的info？

guoaiying · 发表于 2009-12-21 01:35:24

综合的脚本出问题了吧，

XIAOZZ · 发表于 2009-12-22 01:13:58

脚本的问题

tks15 · 发表于 2009-12-24 04:46:15

you perhaps got no clk timing constrain

mingtian2010 · 发表于 2009-12-24 22:07:49

路过学习

qushaobo · 发表于 2009-12-28 16:33:00

影响时序优化.不过关系不大.在FPGA中,我用了,Create_clock以后,和不用,的效果看不出多少.

[求助] "Clk" is an undefined clock 这是什么回事？