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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › DDR Timing Closure – Physicaldesign and STA
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楼主: nifan1977

DDR Timing Closure – Physicaldesign and STA

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semico_ljj
发表于 2007-1-11 14:30:48 | 显示全部楼层
谢谢，要学的还很多！
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semico_ljj
发表于 2007-1-11 14:33:30 | 显示全部楼层
DDR Timing Closure – Physical Design and STA Methodology
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risccpu
发表于 2007-1-15 14:40:47 | 显示全部楼层
DDR的设计对复杂的soc是很关键的
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yxw8193
发表于 2007-1-15 15:59:02 | 显示全部楼层
好多专业术语看不懂，什么datapath。。什么窗。。
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even_ryen
发表于 2007-1-28 16:08:14 | 显示全部楼层
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johnz
发表于 2007-2-10 02:29:11 | 显示全部楼层
看看，谢谢
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semico_ljj
发表于 2007-2-11 18:27:28 | 显示全部楼层
精彩，此文！
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sycall
发表于 2007-2-12 14:26:23 | 显示全部楼层
不错,学习了
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carey
发表于 2007-3-2 16:19:23 | 显示全部楼层
thank's for your share!
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yk2000
发表于 2007-4-24 12:59:51 | 显示全部楼层
支持一下，以后可能会遇到
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