利用dpll实现信号同步的问题,请高手指点...

angelzhang · 发表于 2004-8-27 09:00:25

等最终结束了,我会把思路和大家共享的!

kengifa · 发表于 2004-9-2 22:35:58

我对数字锁相环也很感兴趣，清华大学那个DPLL我试过了，调不通。可能他省略的部分我编的不太好吧。：（

angelzhang · 发表于 2004-9-3 09:01:35

是的,可以直接调试出来的不多，不过,我感觉主要是理解DPLL中f0,Mf0,2Nf0之间的关系,我的理解是f0可以是我们的全局CLK,它是信号流的许多倍,而Mf0,2Nf0可以是我们的信号输入频率,选取合适的模数给可变模计数器,然后产生带有进位,借位的脉冲序列,这两者最为关键!

bandao · 发表于 2006-8-23 09:23:02

非常精彩的讨论,我刚开始接触DPLL,对我很受启发..
感谢大家~~

first1 · 发表于 2006-8-23 23:12:18

DPLL一般用于时钟频率比较低的数据,如果高倍钟的倍数不是很大的话,相位抖动比较大,一般64倍以上.以上最好的方法用模拟锁相的方法,或用NCO的方法比较可行.

sarum · 发表于 2006-8-28 09:20:51

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shenbiao · 发表于 2007-5-29 08:30:45

·清华大学那个DPLL·
是哪本书啊，请告诉一下。

gentlegnat · 发表于 2007-12-11 11:33:23

不错的讨论~~DPLL学习中~~~

xiao19821022 · 发表于 2009-2-13 10:54:57

不知道做出来没有，期待中

liandan · 发表于 2009-2-13 16:28:24

推荐看看时钟恢复方面的文献

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