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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 用VERILOG写的CPU（可综合）
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楼主: gjqiang

用VERILOG写的CPU（可综合）

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发表于 2012-12-3 22:39:06 | 显示全部楼层
有你的~~
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发表于 2012-12-11 21:11:25 | 显示全部楼层
好东西啊！！！！！！
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发表于 2012-12-11 22:16:48 | 显示全部楼层
CPU这么容易用Verilog描述吗？
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发表于 2012-12-16 21:40:01 | 显示全部楼层
bucuo o
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发表于 2013-10-24 16:14:17 | 显示全部楼层
谢谢楼主，是夏雨闻老师编写的那本吗
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发表于 2013-10-24 16:15:39 | 显示全部楼层
谢谢楼主，是夏宇闻老师编写的那本教材吗
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czd
发表于 2013-10-28 20:30:09 | 显示全部楼层
真的吗！！！
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发表于 2014-9-14 11:45:36 | 显示全部楼层
好，谢谢
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ylry00
发表于 2014-10-27 11:01:18 | 显示全部楼层
其中一章
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发表于 2014-10-27 17:21:58 | 显示全部楼层
看起来很厉害的样子
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