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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 用VERILOG写的CPU（可综合）
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楼主: gjqiang

用VERILOG写的CPU（可综合）

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cdstudy
发表于 2009-11-6 14:04:22 | 显示全部楼层
have a look
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ccc630
发表于 2009-11-6 21:40:40 | 显示全部楼层
thanksssssssssssssssssssssssssssssssssssssss
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发表于 2009-11-29 10:55:24 | 显示全部楼层
学习中，谢谢！
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发表于 2009-11-29 10:57:50 | 显示全部楼层
ddddddddddddddddddddddddd
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haip
发表于 2009-11-29 19:48:57 | 显示全部楼层
看一下，谢谢分享
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skylie
发表于 2009-11-29 23:03:00 | 显示全部楼层
看看~~~~~~
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hwcomcn
发表于 2009-11-29 23:09:12 | 显示全部楼层
能看懂cpu真好，要朝这个放心努力
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发表于 2009-12-9 15:21:53 | 显示全部楼层
谢谢分享！！
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发表于 2009-12-9 15:40:04 | 显示全部楼层
谢谢分享！！
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titan.cn
发表于 2009-12-12 21:35:15 | 显示全部楼层
谢搂主了,最近正好找这方面的参考资料
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