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希望哪位大牛能给一些帮助。先谢谢了

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发表于 2009-8-8 19:59:19 | 显示全部楼层 |阅读模式

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这是我的程序的错误部分,错误肯定是在这里。但是我一直都不知道怎么改,都好多天了也没有头绪,希望哪位大牛能给一些帮助。先谢谢了。
if(clk'event and clk='1')  then      --  时钟触发
  for i in 31 downto 0 loop
     if(msum(31)='0')    --判断最高位是不是零,是则左移一位,计数器加一。
        then

               msum1(31 downto 1)<=msum(30 downto 0);
            msum1(0)<='0'  ;
   
            conter<=conter+'1'  ;
         else
              exit;
     end if;
msum<=msum1;
  end loop;
          end if;

报错:
Error (10001): Verilog HDL or VHDL error at addN.vhd(25): can't infer register for msum[0] because it does not hold its value outside the clock edge
Error (10001): Verilog HDL or VHDL error at addN.vhd(25): can't infer register for msum[1] because it does not hold its value outside the clock edge
Error (10001): Verilog HDL or VHDL error at addN.vhd(25): can't infer register for msum[2] because it does not hold its value outside the clock edge
Error (10001): Verilog HDL or VHDL error at addN.vhd(25): can't infer register for msum[3] because it does not hold its value outside the clock edge
Error (10001): Verilog HDL or VHDL error at addN.vhd(25): can't infer register for msum[4] because it does not hold its value outside the clock edge
发表于 2009-8-9 11:39:58 | 显示全部楼层
能否将你的例子完整的贴上来?
发表于 2009-8-9 13:08:51 | 显示全部楼层
东西是好,可惜没那么多信元了。
发表于 2009-8-11 15:25:25 | 显示全部楼层
88   看不懂什么东西
发表于 2009-8-13 18:52:20 | 显示全部楼层
我是学的VERILOG,不懂vhdl 啊
发表于 2009-8-13 19:07:38 | 显示全部楼层
发表于 2009-8-13 22:39:24 | 显示全部楼层
你要实现什么功能呢?这样的代码风格不好,,
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