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Third-Party Products & Services
Xilinx System Generator™ for DSP
Simulink blockset for bit- and cycle-accurate simulation and code generation for Xilinx FPGAs
 
Description:
The Xilinx System Generator for DSP is a plug-in to Simulink that enables designers to develop high-performance DSP systems for Xilinx FPGAs. Designers can design and simulate a system using MATLAB, Simulink, and Xilinx library of bit/cycle-true models. The tool will then automatically generate synthesizable Hardware Description Language (HDL) code mapped to Xilinx pre-optimized algorithms. This HDL design can then be synthesized for implementation in Virtex-II Pro Platform FPGAs and Spartan-IIE FPGAs. As a result, designers can define an abstract representation of a system-level design and easily transform this single source code into a gate-level representation. Additionally, it provides automatic generation of a HDL testbench, which enables design verification upon implementation.
回答网友问题:sg dsp不需要sn, 电脑里需要装matlab和ise,具体要求为:
System Generator for DSP 9.1.01
Required:
Windows XP
ISE 9.1i Service Pack 3 or later
ISE 9.1i IP Update 2 or later
MATLAB R2006a or R2006b from MathWorks; see (Xilinx Answer 23145) for the required MATLAB 2006a patch.
Optional:
ISE 9.1i Service Pack 3 Virtex-5 LX220T/SXT Installer
ChipScope 9.1i
EDK 9.1i
Synplicity Synplify Pro 8.6.2
Model Technology ModelSim 6.1f
PS:给一个sysgen 实例的链接,非常详细,且带源文件
http://www.eetop.cn/bbs/thread-173032-1-1.html
[ 本帖最后由 llxmars 于 2009-7-18 07:44 编辑 ] |
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System generator_v9_1.part09.rar
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Getting Started Guide
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Reference Guide
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User's Guide
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