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楼主: 老扁

Synopsys已经宣布了SystemC是末路黄花

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发表于 2007-1-26 08:32:09 | 显示全部楼层
观望。
发表于 2007-2-1 22:54:44 | 显示全部楼层
根据发展定输赢。
发表于 2007-2-3 10:50:02 | 显示全部楼层
根据这几年发展看来SystemC还是很不错的
在系统级TLM级SystemC还是有一席之地的嘛。。。
发表于 2007-2-4 05:14:16 | 显示全部楼层
are you sure? that is bad news
发表于 2007-2-16 00:03:11 | 显示全部楼层


原帖由 loco 于 2007-1-25 19:07 发表
SYSTMC还是可以用的




在验证方面还是要逊色不少(北美地区几乎全部倒向SystemVerilog),作为建模语言还可以吧
发表于 2007-3-2 15:58:09 | 显示全部楼层
看看
长见识了
发表于 2007-3-4 03:18:00 | 显示全部楼层
有神么systemverilog资料?
发表于 2007-3-5 20:49:56 | 显示全部楼层
不知道哪里有详细的说明看看,楼主是否可以把链结附上
发表于 2007-3-6 19:43:47 | 显示全部楼层
因为synopsys现在是力推SV的,其实SC和SV是各有所长的
发表于 2007-3-6 21:28:08 | 显示全部楼层
用软件的思路来设计硬件确实比较难!
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