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楼主: syd613

用verilog写的3分频设计

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vcing
发表于 2009-6-10 23:03:27 | 显示全部楼层
bucuo,dingyige
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raulqql
发表于 2009-10-3 10:49:46 | 显示全部楼层
顶一个
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yuanpin318
发表于 2009-10-3 11:27:27 | 显示全部楼层
just so so,
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Macnail
发表于 2009-11-8 16:15:14 | 显示全部楼层
Goood.......
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hijackly
发表于 2009-11-9 16:55:54 | 显示全部楼层
学习PFGA的用法，不是很会用俄
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hhjjtt
发表于 2009-11-9 17:00:31 | 显示全部楼层
阿放松对分散对方发
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csl318
发表于 2009-11-10 11:07:06 | 显示全部楼层
支持，有点启发
1# syd613
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zoujinbo
发表于 2009-11-10 13:56:40 | 显示全部楼层
顶一个，呵呵
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tt
发表于 2009-11-11 11:13:37 | 显示全部楼层
看看.................
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scm
发表于 2010-9-30 14:30:15 | 显示全部楼层
学习了
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