请教关于高扇出的问题

tory60515 · 发表于 2008-12-3 18:17:15

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如果说一个设计中有一个加法器去驱动32个乘法器，关键路径为一个加法器（负载32个乘法器）和一个乘法器；那么一个加法器去驱动32个寄存器，这时的关键路变为一个加法器的延时，是否后者的时钟频率会更高呢？
（后者一个加法器驱动32个寄存器是否叫高扇出呢？？）

eestone · 发表于 2008-12-3 18:36:44

看不懂你的问题

你是说高扇出会带来更多延时还是啥意思？

tory60515 · 发表于 2008-12-4 12:59:41

就是说两种设计那个的关键路径延迟要小一些

jep · 发表于 2008-12-4 14:45:27

为什么不是一个加法器的输出直接复制,然后各驱动16个乘法器呢?

jjww97030 · 发表于 2008-12-5 10:47:15

当然是后一种频率高了

chentiejian · 发表于 2009-1-2 20:10:34

应该不是的，我认为第二个也是二者之和

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