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最近要做一个显示控制器,输入信号为16Bit×50MHz的数字视频信号,图像格式为[email=1280×1024@20Hz]1280×1024@20Hz[/email],输出为[email=1280×1024@65Hz]1280×1024@65Hz[/email],初步的方案:使用一片FPGA做控制器,一片32Bits的SDRAM做缓存。
现在的问题是:如果使用乒乓的方式,需要两片SDRAM,一片写入时,另一片读出。这个方案比较简单,但需要耗费太多的引脚和多一片的SDRAM。如果使用单片SDRAM,需要对SDRAM同时进行读出和写入,需要比较复杂的缓存控制机制。
不知道那位兄弟有没有更好的解决方案。 |
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