EDA入门套件设计实例详解

greenpine · 发表于 2003-12-12 13:52:11

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LBSALE[100]LBSALE[这个贴子最后由greenpine在 2003/12/15 08:16am 第 1 次编辑]

greenpine · 发表于 2003-12-12 14:14:09

例子都是vhdl的，包括秒表等

bravelu · 发表于 2003-12-12 14:14:59

总要做个广告吧？里面有什么内容？

greenpine · 发表于 2003-12-12 14:22:26

用VHDL语言制作秒表
1.功能和要求:
1/100S计时器常用于体育竟赛及各种要求有较精确订时的地方.其功能主要有
(1).精度应大于1/100S;
(2).计时器最长计时时间为1h,故需6位显示器,例如 36分12秒56(1/100);
(3).设置复位和启停开关, 复位开关用于使计时器清零,按一下启停开关计时器开始
计数,再按一下启停开关计时器停止计数; 复位开关可以在仍何情况下使用,即使
在计时过程中,只要一按复位开关,计时进程应立即停止,并对计时器清零.
2.制作思路:
秒表的核心部件是6位计数器,每个计数器由四位二进制数组成.计数器的时钟信号
为100hz.每按一次按键开关输入一个单脉冲用于复位和启停.由于EDA实验板上只
有4为数码管,故需借用LED指示灯资源.用数码管左边两位显示(分),用数码管右边
两位显示(秒),用LED左边四位直接显示(1/100)高位(二进制形式),用LED右边四位
显示(1/100)低位.
可以用6个串行进位计数器作为核心,计数器最低位时钟为100hz方波; 100hz方波可
由对光盘中os.xnf(相当于晶振)适当分频得到。

3.源程序注释:
library IEEE;
use IEEE.std_logic_1164.all;
use IEEE.std_logic_unsigned.all;
entity counter60 is
port (
      reset:in std_logic;                      -------reset为清零信号
      stop:in std_logic;                      -------stop为启停信号
      led

ut std_logic_vector(6 downto 0); -------led为数码管7段显示信号
dig

ut std_logic_vector(3 downto 0);    ------dig为数码管位选信号
      bcd1: inout STD_LOGIC_VECTOR (3 downto 0); ----bcd1为1/100s低位
      bcd10: inout STD_LOGIC_VECTOR (3 downto 0)---bcd10为 1/100 高位
);
end counter60;

部分内容

greenpine · 发表于 2003-12-12 14:28:09

还想要啥，除pci源码外，每个500，便宜大甩卖了

xiejh · 发表于 2003-12-12 15:14:54

网上到处都是，就这还要钱，强烈b4!!

greenpine · 发表于 2003-12-12 16:01:42

网上找不到的大多是需要rmb的

一声叹息 · 发表于 2003-12-12 16:29:54

说句实话，的确不值这个价钱，赫赫。可不要介意啊！

老扁 · 发表于 2003-12-12 17:30:48

呵呵。
有点欺负不识货的DDMM的嫌疑哦。玩笑玩笑。
也说句实话，这些东西的价格8.88比较合适。呵呵。

洋洋 · 发表于 2003-12-12 18:21:05

我钱多！不过也怕老大你啊！

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