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使用VHDL进行分频器设计

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发表于 2008-10-20 16:53:10 | 显示全部楼层 |阅读模式

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本文使用实例描述了在FPGA/CPLD上使用VHDL进行分频器设计,包括偶数分频、非50%占空比和50%占空比的奇数分频、半整数(N+0.5)分频、小数分频、分数分频以及积分分频。所有实现均可通过Synplify Pro或FPGA生产厂商的综合器进行综合,形成可使用的电路,并在ModelSim上进行验证。

使用VHDL进行分频器设计.pdf

412.19 KB, 下载次数: 176 , 下载积分: 资产 -2 信元, 下载支出 2 信元

发表于 2008-12-16 17:56:24 | 显示全部楼层
我为什么不能查看?
发表于 2009-2-25 15:38:14 | 显示全部楼层
HEHE 不错
发表于 2009-3-16 14:53:32 | 显示全部楼层
不会吧,还没打开下载就扣钱了。
发表于 2009-4-28 10:40:36 | 显示全部楼层
下来学习,谢谢LZ
发表于 2009-5-3 18:10:19 | 显示全部楼层
我下载的是好的啊,大家误会楼主了
发表于 2009-5-5 11:16:54 | 显示全部楼层
正需要呢


谢了

哈哈

支持你的分享
发表于 2009-5-29 23:12:26 | 显示全部楼层
回一下,谢谢哈
发表于 2009-6-15 09:13:24 | 显示全部楼层
xiexie
发表于 2010-2-3 14:29:35 | 显示全部楼层
非常好!谢谢楼主!
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