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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › SystemVerilog Assertions经典实例
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楼主: qiu-zq

SystemVerilog Assertions经典实例

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carson593
发表于 2008-9-22 21:21:08 | 显示全部楼层
goood gooood
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carson593
发表于 2008-9-22 21:30:01 | 显示全部楼层
fei chang hao
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hwlyic
发表于 2008-9-28 11:42:25 | 显示全部楼层

好东西，帮定了

好东西，帮定了
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0xffff
发表于 2008-9-29 08:41:24 | 显示全部楼层
好东西谢谢
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zz_3070
发表于 2008-10-3 08:38:59 | 显示全部楼层
很好，就一个附件！
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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yjh
发表于 2008-10-8 14:33:29 | 显示全部楼层
顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶
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yuanchuang
发表于 2008-10-11 00:41:36 | 显示全部楼层
good,looking it
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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wkk666
发表于 2008-10-12 11:50:01 | 显示全部楼层
SystemVerilog Assertions经典实例
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wkk666
发表于 2008-10-12 11:51:44 | 显示全部楼层
SystemVerilog Assertions经典实例
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demin
发表于 2008-10-13 16:36:35 | 显示全部楼层
goodgood
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