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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › SystemVerilog Assertions经典实例
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楼主: qiu-zq

SystemVerilog Assertions经典实例

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bornforhappy
发表于 2009-10-13 11:33:52 | 显示全部楼层
这个在modelsim下可以跑吗？
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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daniu1688
发表于 2009-10-13 15:38:56 | 显示全部楼层
再顶顶、顶
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cacc
发表于 2009-10-18 13:16:52 | 显示全部楼层
thank you
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peter_wx
发表于 2009-10-18 13:20:07 | 显示全部楼层
THANKS FOR SHARING
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wowo0128
发表于 2009-10-30 09:23:11 | 显示全部楼层
楼主辛苦了，多谢！
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huaashan
发表于 2009-10-31 22:39:52 | 显示全部楼层
大力支持好东西
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yinpeng11
发表于 2009-11-2 13:12:24 | 显示全部楼层
学习了啊 学习了 谢谢
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lint
发表于 2009-11-13 10:49:03 | 显示全部楼层
good,thx
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pkulafang
发表于 2009-11-13 17:59:49 | 显示全部楼层
谢谢楼主！！
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kingdomwang
发表于 2009-11-13 21:26:21 | 显示全部楼层
thank your share
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