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楼主: 没事乱弹琴

verilog hdl 和vhdl哪一个以后比较有用呀?请各位大侠指教

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发表于 2006-12-22 11:52:28 | 显示全部楼层

回复 #1 没事乱弹琴 的帖子

It depend on what kind of project you will going. They are the same.
But vhdl is more strickly than verilog.
发表于 2006-12-30 11:07:45 | 显示全部楼层
个人经验:
如果你喜欢C语言,可以学VERILOG
如果你喜欢PASCAL,可以学VHDL
发表于 2006-12-30 17:44:17 | 显示全部楼层
verilog 可以描述到单级的三极管开关特性
发表于 2006-12-30 19:30:10 | 显示全部楼层
感觉上好一些
发表于 2006-12-30 19:34:18 | 显示全部楼层
感觉上好一些
发表于 2006-12-30 19:37:28 | 显示全部楼层
感觉上好一些
发表于 2006-12-30 19:42:57 | 显示全部楼层
感觉上好一些
发表于 2006-12-30 19:44:22 | 显示全部楼层
感觉上好一些
发表于 2006-12-30 19:51:11 | 显示全部楼层
感觉上好一些
发表于 2006-12-30 19:52:27 | 显示全部楼层
感觉上好一些
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