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verilog hdl 和vhdl哪一个以后比较有用呀?请各位大侠指教

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发表于 2006-2-19 23:03:17 | 显示全部楼层 |阅读模式

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我事一个新人  想学一下   请问哪一个以后比较有前途?
发表于 2006-2-20 12:49:34 | 显示全部楼层

verilog hdl 和vhdl哪一个以后比较有用呀?请各位大侠指教

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<a href=topic.cgi?forum=5&topic=3211>该贴子已被管理员转移,请点击这里查看</a>
发表于 2006-10-7 14:37:29 | 显示全部楼层
verilog
发表于 2006-10-7 14:38:30 | 显示全部楼层
公思用的VERILOG多
发表于 2006-10-11 11:24:59 | 显示全部楼层
我也想知道
发表于 2006-10-11 15:19:24 | 显示全部楼层
vhdl好
发表于 2006-10-12 08:56:40 | 显示全部楼层
其实是一样的用!!都能达到要求,你学了一个例外一个就很容易~~!!
发表于 2006-10-12 09:54:09 | 显示全部楼层

Verlog

感觉上好一些
发表于 2006-10-14 15:03:00 | 显示全部楼层
用verilog的多一些
发表于 2006-10-21 20:12:58 | 显示全部楼层
两个都很有用,学会一种再学另外一种也很容易。
国内用Verilog的多,所以可以先学这个
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