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静态时序分析(Static Timing Analysis)基础及应用

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发表于 2008-5-26 12:15:40 | 显示全部楼层 |阅读模式

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在制程进入深次微米世代之后,芯片(IC)设计的高复杂度及系统单芯片(SOC)设计方式兴起。此一趋势使得如何确保 IC 质量成为今日所有设计从业人员不得不面临之重大课题。静态时序分析(Static Timing Analysis 简称 STA)经由完整的分析方式判断 IC 是否能够在使用者的时序环境下正常工作,对确保 IC 质量之课题,提供一个不错的解决方案。然而,对于许多 IC 设计者而言,STA 是个既熟悉却又陌生的名词。本文将力求以简单叙述及图例说明的方式,对 STA 的基础概念及其在 IC 设计流程中的应用做详尽的介绍。

静态时序分析(Static Timing Analysis)基础及应用.pdf

744.87 KB, 下载次数: 404 , 下载积分: 资产 -2 信元, 下载支出 2 信元

发表于 2008-5-26 21:34:53 | 显示全部楼层
不错                                  正是我所要~
发表于 2008-5-31 18:59:57 | 显示全部楼层
ding ding ding zhi chi !!!
发表于 2008-6-1 01:28:22 | 显示全部楼层
謝謝!
发表于 2008-6-1 15:08:41 | 显示全部楼层
呵呵,这个很不错的
发表于 2008-6-1 15:09:32 | 显示全部楼层
特别是上面还有很多例子,分析一下,真是学到不少东西
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发表于 2008-6-2 10:04:07 | 显示全部楼层
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发表于 2008-6-2 18:13:22 | 显示全部楼层
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发表于 2008-6-3 22:54:02 | 显示全部楼层
下载下来看看,正好是需要的
发表于 2008-6-4 09:42:49 | 显示全部楼层
需要好好研究一下
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