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楼主: wz_cdj

Verilog Testbench设计技巧和策略

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发表于 2010-6-10 21:42:17 | 显示全部楼层
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发表于 2010-6-10 21:44:25 | 显示全部楼层
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发表于 2010-6-11 07:41:28 | 显示全部楼层
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发表于 2010-6-11 07:58:38 | 显示全部楼层
delay_section4[0]
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发表于 2010-6-18 21:22:09 | 显示全部楼层
ddddddddddddddd
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发表于 2010-6-18 21:29:16 | 显示全部楼层
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HUGJIL
发表于 2010-6-20 16:41:58 | 显示全部楼层
huifukle
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发表于 2010-6-22 11:41:08 | 显示全部楼层
谢谢分享~！！
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发表于 2010-6-22 13:56:27 | 显示全部楼层
看看先.....
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发表于 2010-7-3 14:17:35 | 显示全部楼层
xiexiefenxiang
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