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[求助] 怎样验证有多个跨时钟域的设计？ 新人帖 aleebj 2023-10-16 1506 年轻的韭菜 2023-10-16 15:32
[求助] 怎样做到force design里面的wire信号但是不影响wire的另一端？ goodideaooo 2023-10-1 5647 liheng369 2023-10-16 11:56
[求助] UVM 中怎么引入reference model或者是C model attach_img  ...2 leapoo 2014-7-23 1610695 gerry1812 2023-10-14 20:30
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[求助] ads中HBT模型问题 attach_img ZhiyongD 2023-10-11 4442 dongming 2023-10-12 21:17
[求助] 关于I2C时序异常的问题 XAUT.ZDH 2023-10-11 2485 XAUT.ZDH 2023-10-12 11:27
[求助] VCS能产生Indago的database吗 liheng369 2023-10-10 3528 saipolo 2023-10-11 21:05
[求助] USB3老是在发送数据时进入Recovery oscillator_cn1 2023-10-11 0375 oscillator_cn1 2023-10-11 18:52
[求助] vcs报错[RCUIPNA] Illegal references to $unit 新人帖 zjzaaa 2023-8-2 4629 zjzaaa 2023-10-11 15:45
[求助] 四五年以上的验证工程师在哪找啊？？  ...2 Distent 2023-9-25 141248 j1j1j1 2023-10-10 17:41
[求助] 后仿真有时钟的概念吗？ 新人帖 飘雨的季节65 2023-9-16 2597 gaurson 2023-10-10 17:29
悬赏 [求助] uvm，验证环境怎么通过generate例化多个接口相同但是时钟不同的clocking块 - [悬赏 100 信元资产] yd452133823 2023-10-7 2466 zhangdeshuai 2023-10-10 17:24
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[求助] 什么时候用uvm do来启动sequence呢 zhuimeng2020 2023-10-6 0392 zhuimeng2020 2023-10-7 18:09
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