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查看: 2400|回复: 1

[原创] J750如何定义下面CLK的波形！

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hacker888
发表于 2013-3-2 07:22:08 | 显示全部楼层 |阅读模式

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机台的为CLK200 CYCLE ，dqs在CLK200下降沿输出
clk是CLK200的二分频，但有固定的延迟，
主要设定成什么：如NR,RL等，而且D0,D1,D2,D3如何设置
                       谢谢！
而且
ddr.bmp

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畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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Josh_wei
发表于 2013-7-2 10:45:43 | 显示全部楼层
D0,D1,D2,D3怎么看不清楚呢？是哪几个信号？
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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