跑tsmc I/O的LVS出现错误

brighchu · 发表于 2022-10-21 10:49:15

自己建个schematic/symbol，shematic里面只放PIN进去，导出IO顶层的网表，把foundry给的IO的spi网表include到顶层网表去跑LVS

brighchu · 发表于 2022-10-24 09:34:05

最终守护你发表于 2022-10-21 17:23
那这样的话每个IO我都得重新建立一个schematic和symbol吗？

不用啊，spice网表直接import到库里产生schematic，用Verilog生成symbol

brighchu · 发表于 2022-10-24 14:22:02

最终守护你发表于 2022-10-24 12:04
我能问一下你说的verilog生成symbol这个步骤需要怎么做呢？

File->Import->Verilog In

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