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楼主: buley

[统计] 你是用VHDL还是用Verilog HDL?

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发表于 2011-11-24 17:08:00 | 显示全部楼层
从理解和业界的实际情况来看,显然VERILOG占了绝对的主流
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发表于 2011-11-24 22:43:08 | 显示全部楼层
学的就是verilog  觉得跟C有相通之处。比较好学
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发表于 2011-11-24 22:48:09 | 显示全部楼层
verilog
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发表于 2011-11-27 20:13:59 | 显示全部楼层
准备转向verilog了,向主流靠拢
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发表于 2011-11-28 11:31:37 | 显示全部楼层
两个都用,没事
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发表于 2011-11-28 22:28:14 | 显示全部楼层
verilog
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发表于 2011-11-29 12:26:22 | 显示全部楼层
支持vhdl
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发表于 2011-11-29 13:45:56 | 显示全部楼层
感觉verilog培养起来比vhdl要快些
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发表于 2011-11-30 10:10:56 | 显示全部楼层
还是verilog用的人多一点
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发表于 2011-12-1 13:56:27 | 显示全部楼层
verilog
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