求助一个初级问题！！！

春野雪 · 发表于 2015-9-5 14:40:24

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为什么异步复位，没有延迟一个时钟周期？？？求助，谢谢！！

yangptzn · 发表于 2015-9-5 19:35:19

回复 1# 春野雪
顶6666666

orlye · 发表于 2015-9-5 19:40:51

应该是negedge i_rst_n

harry_hust · 发表于 2015-9-5 22:17:12

回复 1# 春野雪

感觉这个已经跟复位没关系了，上面是非阻塞赋值，下面却变成阻塞式赋值了（波形），看看是不是仿真的原因

春野雪 · 发表于 2015-9-5 22:43:18

回复 4# harry_hust
是非阻塞赋值，你可以试一下，谢谢！！！

harry_hust · 发表于 2015-9-5 22:50:14

回复 5# 春野雪

不知道你这个综合过了没有，复位信号确实没有匹配上，上升沿触发异步复位但是内部逻辑却是低电平复位，这里是有矛盾的。但是为什么会产生阻塞式赋值的现象，这个还请其他大神解释。

haimo · 发表于 2015-9-6 09:37:50

如果改为negedge i_rst_n就没有这个问题了。

cqugjw · 发表于 2015-9-6 10:53:04

你明明是低电平复位，为什么要写posedge？

tiancaijiameng · 发表于 2015-9-6 13:34:06

异步复位应用的i_rst_n是FPGA寄存器自带的异步清零端（CLR），它不会占用FPGA的内部资源消耗；而同步复位是将i_rst_n作为输入逻辑使能信号，会增加FPGA内部资源消耗，FPGA运行时会先进行这个信号的判断，所以会有一个时钟的延迟。下面的是同步复位
QQ图片20150906133032.png

异步复位就是将同步中的rst连接到下端的CLR上。

春野雪 · 发表于 2015-9-6 14:01:56

回复 6# harry_hust

复位是没匹配上，不好意思是我写错了，但是这不是原因所在，negedge i_rst_n也是一样的。

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