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pengyong820954 · 发表于 2013-10-7 20:57:04

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在CTS之前，对一条path做timing分析的时候，对于一个寄存器D端的setup hold，工具是如何查表的啊，我看.lib中setup hold是关于D端输入transition和clock的transition来得到的。可是此时的clock是ideal的，显然超出了查表的范围了，我猜想是不是工具取的表中clock transition最小的值来算出来的啊，请大虾指明

zero_0 · 发表于 2013-10-8 09:34:31

“可是此时的clock是ideal的，显然超出了查表的范围”？

pengyong820954 · 发表于 2013-10-8 10:20:02

回复 2# zero_0

clock是ideal，此时的transition怎么取值呢，因为表中的clock的transitions是从一个值逐渐变大的

pengyong820954 · 发表于 2013-10-8 20:56:33

大虾没人留点什么吗

pengmingguo · 发表于 2013-10-9 08:45:58

你理解的ideal clock是什么呢？

pengyong820954 · 发表于 2013-10-9 22:29:41

回复 5# pengmingguo

就是network为0，驱动无穷大吧

chyauchyau · 发表于 2013-10-18 00:57:13

clock path歸clock path
data path歸data path
不要混為一談

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