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查看: 4339|回复: 17

[求助] analog verification的前景怎么样

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发表于 2013-7-20 19:10:37 | 显示全部楼层 |阅读模式

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小弟在学校时做analog design,找实习时一家有名的IC公司找我去做analog&mixed signal verification,跟我说这块以后很有前景,现在这个领域还没有发展起来,说他们需要有analog背景的人来做这一块,当时听了很激动,觉得挖到一块瑰宝。去了之后发现基本就是对模拟模块用verilog-AMS语言行为级建模,个人认为毫无技术含量可言啊。根本不需要有什么模拟基础,也不用理解电路原理,知道输入输出信号就行了。现在很纠结到底要不要继续从事下去,总觉得做analog verification的话,能力提升有限,很可能做5年和做1年的收获是一样的,还是倾向于做analog design。求大家提供意见
发表于 2013-7-20 20:25:43 | 显示全部楼层
你不想去让我去吧,这么好的机会不珍惜,而且还是大公司
 楼主| 发表于 2013-7-20 22:17:36 | 显示全部楼层
回复 2# jiang330226
但是不知道做这个方向发展如何,毕竟如果做analog design的话,是很看重经验,越老越吃香,analog verification这块感觉不需要太多的经验啊
发表于 2013-7-20 22:42:04 | 显示全部楼层
一般是大公司才会有特别做这块的人,如果没有下去做analog
那接下来要跳会很难跳因为现在很少公司在开发新架构........只有很少很少的地方会要...
如果您会想一直待在这个司就ok...
 楼主| 发表于 2013-7-20 23:26:21 | 显示全部楼层
回复 4# tulipbear97

是啊,这也是我考虑的点,小公司不会养做analog verification的人,就业面很窄。。。舍不得是这家公司是知名外企,出去找design的工作,不一定能找到这么大的平台。。。请问你了解analog verification这块技术成长度高不高?
发表于 2013-7-21 15:18:11 | 显示全部楼层
lz在LSI吗
 楼主| 发表于 2013-7-21 22:39:50 | 显示全部楼层
回复 6# seles314

ADI实习。。。
发表于 2013-7-22 07:27:48 | 显示全部楼层
我倒觉得model没有那么简单
topdown设计的话,model应该在系统设计初期就应该介入
然后在过程中不断的迭代
最终电路完成的时候,有套与电路匹配的model
倒是觉得这种活找新人干可能不大合适,又负责系统的人来兼着做可能更合适
发表于 2013-7-22 14:19:09 | 显示全部楼层
和design的成长路线完全不一样,而且这个明显比design好。。。你是做建筑设计的,design是带安全帽的那个,你说是吧
 楼主| 发表于 2013-7-22 23:38:44 | 显示全部楼层
回复 9# kwankwaner
但是我觉得这个和语言的建模联系太紧密了,而且对模拟水平的要求也不高,主要是验证模块的function,不是performance,所以是纯粹的理想建模。感觉从事这行的话,技术成长不大。。。不像做模拟可以越老越吃香。。。不懂我理解的对不对
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