lib文件编写问题

cinderella945 · 发表于 2012-11-10 10:03:02

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公司要交付一个DAC IP，要提供其时序文件lib.考虑到是模数混合的模块，
我就没有走数字流程，直接按照工艺厂商提供的标准单元lib依样画葫芦定义了一个lib.
其中定义了一个cell,然后对该IP的端口的名称、电容啥的描述了一下。
现在遇到的问题如下：
该IP有3个由输入时钟CLK触发的输出A、B、C,他们工作的先决条件不一样，我用3个ff语句描述它们，
结果报错说一个cell里面只能定义一个ff,请问这种情况该怎么处理呢？

陈涛 · 发表于 2012-11-10 13:20:39

这个需要对lib的文法有比较深刻的了解
你可以试几个偷懒的方法，
1，定义一个内部flop，ABC都是它的输出pin，如果这个满足不了你的要求，可以试
2，写一个有3个flop的逻辑电路，加上timing后，从工具里写一个lib出来，你再照着那个格式改一改

icfbicfb · 发表于 2012-11-10 20:57:11

pt: extracted timing model ,,

cinderella945 · 发表于 2012-11-13 13:30:18

回复 2# 陈涛

谢谢陈大版主，你说的方法2可能可以，我试试看~

cinderella945 · 发表于 2012-11-13 13:39:28

回复 3# icfbicfb

谢谢，这个貌似是针对数字电路的吧

sjtusonic · 发表于 2012-11-13 13:47:17

回复 1# cinderella945

你可以参考一下多端口ram的lib怎么写

sjtusonic · 发表于 2012-11-13 15:56:22

回复 2# 陈涛

第二个办法很巧妙啊！

cinderella945 · 发表于 2012-11-13 16:50:36

回复 6# sjtusonic

请问一下，多端口ram的lib资料从哪里可以找到呢？

sjtusonic · 发表于 2012-11-13 17:00:28

回复 8# cinderella945

这个。。。
你还是按照陈版主的方法做吧

[求助] lib文件编写问题

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