DFT scan chain

otogyg · 发表于 2012-3-12 10:52:35

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大家好，有没有做过DFT的，小弟有问题请教下。
谢谢。

otogyg · 发表于 2012-3-12 11:19:21

是这样，设计中时钟的正沿和反沿都用到了。而且正沿逻辑要影响到反沿逻辑，这样即使把反沿的flop串到前面，在capture phase 的时候，有些反沿触发的flop还是会抓到新的数据。

有大虾知道怎么解决这样的问题吗。
小弟不胜感激啊。

wrhwindboy · 发表于 2012-3-12 11:24:47

你的这个正反都用到的是违反dft规则的，一般的做法是用scanmode信号吧反沿的信号在scan 模式时调整为正沿的，

otogyg · 发表于 2012-3-12 12:55:50

回复 3# wrhwindboy

没办法，design里就这么写的，而且改不了，能说下具体怎么做吗？
非常感谢！

wrhwindboy · 发表于 2012-3-12 19:32:32

不需要改变用户模式的逻辑电路，就是加一个scanmode的控制信号，在 scan的时候，把不符合scan要求的电路变为符合scan要求的格式，和用户路径没关系。你说的不能改逻辑，那就是你们的project manage的问题，你们既然要用scan，你说的明显是不符合scan要求的逻辑，除非你这部分电路不做scan，不然就要改逻辑，把它变成可scan化的，这种都是项目管理的基本问题。

otogyg · 发表于 2012-3-12 19:42:05

回复 5# wrhwindboy

谢谢，我要去向老大反应下。呵呵。

顺便问下，如果可以把所有反沿逻辑放到整个设计的最后端，这样可以做scan吗？

eleven61525157 · 发表于 2012-3-12 20:48:02

回复 1# otogyg

串到不同的链上去，DFTC中设置成mix_clock_not_mix_edge。
DFT中式要避免出现同一链上出现双沿时钟的

sigurd · 发表于 2012-3-12 22:26:08

you can split scan chain into 2 group.
group #1 is using positive edge clock and other one is using negative edge clock.
DFT tool can support this kind of function.

richardxingxing · 发表于 2012-3-12 22:34:29

同学习了

wrhwindboy · 发表于 2012-3-13 18:58:40

分成2条scan这样是不是还要定义不同的scan clock，还有就是反向沿的DFF工具会自动认识吗？然后把反向沿的串一条chain，不然如果有很多是不是要脚本里面指定？
没用过这样的，不过lockup cell的方式是用过，前提是clock domain划分的很清楚的。不然可能会加很多lock up cell,不知道是不是这样？

[求助] DFT scan chain

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