请大家帮我看一段verilog代码

yanzhengkuaile · 发表于 2011-12-13 10:09:06

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x

代码不写全，大概是这个意思：
case(sel)
2'b00:a=1;
2'b01:a=2;
2'b10:a=4;
2'b11:a=5;
default:a=0;
endcase
如果输入sel=2'bx，则结果是怎样的呢？

shiyinjita · 发表于 2011-12-13 10:16:08

it is 0

yanzhengkuaile · 发表于 2011-12-13 10:19:10

回复 2# shiyinjita

我只知道0是不对的

yanzhengkuaile · 发表于 2011-12-13 10:32:48

没有人知道吗

digimax · 发表于 2011-12-13 10:44:35

这个……难住了

freshair_eet · 发表于 2011-12-13 11:26:38

这是Testbench里面的还是主程序里面的啊？
如果是testbench应该是0啊，如果是主程序就不好说啰

shiyinjita · 发表于 2011-12-13 13:06:06

你用casez来尝试一下

skytang007 · 发表于 2011-12-13 14:25:19

硬件出来肯定是0

falloutmx · 发表于 2011-12-13 15:41:22

方针不好说，硬件的话不存在X

zzczx · 发表于 2011-12-13 16:08:23

直接各个仿真器跑一下不就知道了？

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