CIVGX FPGA QuartusII 11.1 DDR2调试总结。。。快被Altera折磨疯了。。。

psd0208

最近调DDR2，之前调DDR2-533调通了，实际只跑在125M。

后来换了一批DDR2-800，同样的逻辑，反而不能正常读写了？

例化IP的时候，我参数是按照DDR2-800重新例化的。

请问会不会是因为DDR2-800太快了，跑在125M太慢，反而跑不对导致呢？

（PS：使用的是Altera的IP ）

jingke05

yes, it is

psd0208

上面的小朋友是什么意思？

happy_1q

是不是你们这批DDR2-800的型号，不支持你原先设置的CL值了。

晒太阳

有频率下限的。低于这个频率，器件不能正常工作

psd0208

是不是你们这批DDR2-800的型号，不支持你原先设置的CL值了。
happy_1q 发表于 2011-7-29 18:57

                               
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之前调通的是Micron的DDR2-533
现在用的是SamSung的DDR2-800

而我需要的都是工作在125MHz。CL那些参数我都调了。没什么用。写的时序就和预想的不一样，导致读也读不对了。
之前的Micron我抓信号发现是复位后local_ready拉低，直到初始化结束才会拉高。
现在的Samsung却是复位后local_ready就拉高了，这里就觉得不正常。

psd0208

有频率下限的。低于这个频率，器件不能正常工作
晒太阳 发表于 2011-7-30 09:35

                               
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恩，例化IP的时候确实是，设为100MHz就报错，提示最低工作在125MHz。

psd0208

已解决，写上来和大家分享一下。

最初调DDR2是用的Altera的开发板，CIVGX150的FPGA，由于是CIVGX150的FPGA只能使用最新的QuartusII10.1，当时调DDR2的读写都没问题了。

我们生产的板子用的是CIVGX50的FPGA，QuartusII10.1根本不支持，所以被迫又装了11.1，在11.1下调我们板子上的DDR2，怎么也调不通，我都快疯了。local_ready信号本来该初始化结束才拉高的，但是我抓到就是复位后根本不管初始化是否结束就马上拉高了。

后来发现一个细节，之前10.1下例化的IP只占3000多的资源，11.1下例化的IP居然占5000多的资源。我实在没有办法，只有胡乱的试了。

于是我在9.1下重新例化了一下这个IP，参数什么的一点也不动，再重新编译，IP占用的资源降为3000多了，居然读写就正常了。

花了我将近一个星期的时间。我那个郁闷。对Altera强烈不满啊。之前调的时候就发现文档里有的时序图都没画对，这也就罢了，可是最新版本的软件例化的IP居然不好使，我就实在对他很不信任了。

10.1和11.1都是俊龙的人给的，俊龙的工程师说从10.1开始QuartusII有较大变化，是基于什么什么平台开发的。。。（说了一大堆，我不关心也就没仔细听）。。。之前用10.1的时候我们就经常发现，同一个工程不做任何改动，这次编译通过JTAG能正常下载，可能下次编译就是下载不成功（在他的开发板上调试遇到的）。。。问俊龙的人，说不出个所以然，就说10.1是第一个版本，问题多是正常的，让我们用11.1，这会用11.1又出这么个问题。。。

我今天调试的时候还遇到个问题，我读出来的数据会和期望的数据作个比较，如果相等就认为读到的值是正确的，不等就有一个计数器计有多少个读出来的数据不对，我抓信号发现读出来的数据明明就是对的，但是抓到那个错误计数器就是一个劲的计数啊。。。无奈我什么也没动又重新编译了一下。。。这回错误计数器又不计数了。。。

我的工程很简单，就是测试DDR2的读写，时序分析是满足的。。。

liao5237

我需要这个东东，感谢

asyou

我也用Altera的DDR2 IP，遇到一个问题，不知道楼主有没有遇到：在软复位的时候（系统不掉电），DDR2有一定概率初始化不成功！