modelsim后仿和 VCS后仿不一致问题请教

sh_0119 · 发表于 2010-9-30 15:25:29

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同一个设计，反标的sdf文件，PR后的网表，testbench，标准单元仿真模型文件完全一致，
用modelsim仿真，没有问题，过了。
可是用VCS仿真的时候，报一堆的时序问题，并且输出的波形很乱。
PR后，我有做过PT的，PT没有报时序违反。

非常的迷惑，求高手解答。
1.两种工具我都是在testbench文件中用sdf_annotate反标的，且报反标成功，操作是不是正确？
2.以前一直用modelsim后仿，过了就过了，难道modelsim不可靠？
3.VCS才刚刚接触，用它做后仿的时候有什么要特别注意的没？
4.大家用的后仿工具是什么呢？

sh_0119 · 发表于 2010-9-30 15:27:03

急！！求高手解答.

suntou · 发表于 2010-10-15 14:33:13

我都是用vcs，vcs对一些仿真要求比较严格，有个别语法使用跟nc不同，不要着急，你可以查查哪儿出错了，这种问题一般找到就全解决了。

begin_520 · 发表于 2010-10-15 15:44:38

路过瞧瞧

sh_0119 · 发表于 2010-10-16 23:46:21

拜谢。

smart_bee · 发表于 2010-10-17 20:11:51

留爪子。
看看指令吧，是否有些两边仿真器默认开关不一样的地方

angus1208 · 发表于 2010-10-19 01:12:54

thanks

brav · 发表于 2010-10-20 07:59:42

thx....

ydsbanban · 发表于 2010-10-31 10:14:33

学习学习！

ic_qiand · 发表于 2010-11-2 16:46:29

同一个设计，反标的sdf文件，PR后的网表，testbench，标准单元仿真模型文件完全一致，
用modelsim仿真，没 ...
sh_0119 发表于 2010-9-30 15:25

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仔细看下log，modelsim和VCS对一些仿真异常的处理不一样。

比如 sdf 文件中timecheck声明中的一些负值 negative value的处理。

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