当静态时序验证出现violation时应该怎么优化

ckzuan · 发表于 2009-11-24 16:15:56

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当静态时序验证出现violation时，应该怎么优化？希望有过优化经验的各位大侠把经验拿出来分享下。（大概方法是不是：调整下布局，插入缓冲器，还有替换cell提高驱动等）最好是具体的实例啊！先谢谢了！

paneric · 发表于 2009-11-25 11:54:38

hold or setup violation??? pre-layout or post-layout STA???

ckzuan · 发表于 2009-11-25 14:54:23

对！hold or setup violation
至于什么阶段只要后端的就行比如你做完后端的某一步（place 、cts or route）然后STA 出现violation 你是怎么修改的啊？

bjdonkey · 发表于 2009-12-1 00:35:01

2# paneric
同问，经常觉得束手无策的的

damonzhao · 发表于 2009-12-1 09:16:21

根据slack的标准，确定相关路径，然后加buf等

kingmomo135 · 发表于 2010-1-15 02:32:25

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signallv · 发表于 2010-1-15 11:16:40

学习，学习。。。

sunshinell · 发表于 2010-1-15 14:13:44

一般来说APR中用opt可以自动优化，如果不能自动优化成功的，需要手动加入buf，更甚者，你的rtl需要优化，或者约束需要优化

小豆丁 · 发表于 2012-10-10 11:05:05

回复 5# damonzhao

版主，nanoroute之后把drc都修改完了，再进行setup优化，满足了setup，结果出现drc错误，该怎么办？

damonzhao · 发表于 2012-10-10 14:00:33

回复 9# 小豆丁

可以先放一放，进行STA，然后根据STA结果手动修正drc问题

kingmomo135 kingmomo135 当前离线积分 45 头像被屏蔽	发表于 2010-1-15 02:32:25 \| 显示全部楼层提示: 作者被禁止或删除内容自动屏蔽
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