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 发表于 2007-1-2 16:12:56
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| 第三个问题 ncverilog 是功能仿真,通常我不认为它提供所谓的timing simulation,不过因为功能是和timing密切相关的,所以说它反应timing信息也可以.
 从功能级到Post layout都可以用同一个仿真器,事实上也推荐用同一个仿真器,只是每次用来仿真的netlist不一样而已
 
 在ncverilog里你只能看到功能是否正确(通常正确与否取决于时序),但是你看不到timing path,所以分析时序不会用也无法用ncverilog
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