自建器件怎么过LVS

zhengdeyi20 · 发表于 2025-11-26 00:09:12

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自己画的PNP在跑LVS时提示Nothing in layout. pin和标识层都画了想问一下除了画的问题还有其他什么需要注意的吗

qw357 · 发表于 2025-11-26 08:05:56

lvs识别器件是靠layout的特征，通过逻辑运算，如(poly 与 ndiff)识别出mos管。

zhengdeyi20 · 发表于 2025-11-26 08:12:49

qw357 发表于 2025-11-26 08:05
lvs识别器件是靠layout的特征，通过逻辑运算，如(poly 与 ndiff)识别出mos管。

所以还是画的有问题是吗

haydnzhang · 发表于 2025-11-26 09:01:36

找一个pcell对比一下缺啥层。

六山小子 · 发表于 2025-11-26 09:16:58

说明你的LVS rule不对吧

zhengdeyi20 · 发表于 2025-11-26 09:24:14

haydnzhang 发表于 2025-11-26 09:01
找一个pcell对比一下缺啥层。

我是照着pcell画的各种标识层 pin也都不缺但是就是不识别

zhengdeyi20 · 发表于 2025-11-26 09:27:56

六山小子发表于 2025-11-26 09:16
说明你的LVS rule不对吧

这个东西没法验证对不对吧

zhengdeyi20 · 发表于 2025-11-26 09:47:51

补充一下我画的是开槽的pnp 挖了3x3的洞有什么特别注意的地方吗并且想问一下E级的pin是怎么添加的随便放在一个位置就可以吗

wesley_wan · 发表于 2025-11-26 10:06:55

看看lvs文件关于PNP的定义，是不是只有特定面积，或者特定尺寸，比如只有5X5的发射极才会被识别

zhengdeyi20 · 发表于 2025-11-26 10:34:06

wesley_wan 发表于 2025-11-26 10:06
看看lvs文件关于PNP的定义，是不是只有特定面积，或者特定尺寸，比如只有5X5的发射极才会被识别 ...

pdk里提供了3x3和5x5的模型应该是都可以识别我该怎么找lvs里定义pnp的具体位置啊

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