设为首页 收藏本站
在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码，快捷登录

手机号码，快捷登录

搜帖子
EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 一种基于FPGA实现的高速缓存设计
12
返回列表 发新帖
楼主: becoll

一种基于FPGA实现的高速缓存设计

[复制链接]
发表于 2011-1-13 15:11:01 | 显示全部楼层
不错的资料
回复 支持 反对

使用道具 举报

发表于 2011-2-12 15:53:15 | 显示全部楼层
是 高速数据流到低速处理模块 还是 低速数据流到高速处理模块 的设计呢
回复 支持 反对

使用道具 举报

发表于 2011-2-12 15:54:32 | 显示全部楼层
先看看
回复 支持 反对

使用道具 举报

发表于 2011-2-15 00:36:13 | 显示全部楼层
thanks!
EETOP创芯人才网职位发布入口
回复 支持 反对

使用道具 举报

发表于 2011-2-15 17:20:56 | 显示全部楼层
没什么参考
EETOP创芯人才网简历投递入口
回复 支持 反对

使用道具 举报

12
返回列表 发新帖
高级模式
B Color Image Link Quote Code Smilies
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条


手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-8-23 02:37 , Processed in 0.014346 second(s), 3 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表