有关dummy的插入阶段与效用

frank1249 · 发表于 2025-7-30 18:33:58

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大家好, 想请问

1. 加入dummy的动作在PR的chipfinish时加或是在GDS merge之后在calibre裡面加的差异为何? 会比较建议在PR时chip finish就加顺便处理dummy metal带来的SI影响?
2. 加入dummy metal 可能会引入SI问题进而影响timing, 会有其面向的影响吗?
3. 加入dummy OD/POLY (也就是Frond end dummy?)跟filler是不同的加入方式?本质上也是类似end cap的概念?让整体std的运作考量到PSE/OSE的影响维持一致性? 加入dummy OD会对timing或其他有影响? 谢谢大家

Challensys · 发表于 2025-7-30 22:06:29

dummy 影响 timing 可以把违例路径附近的 Dummy 删一波再迭代

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