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楼主: xq19901211

[求助] DFE sampler tap添加

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发表于 2025-7-6 18:02:17 | 显示全部楼层


   
xq19901211 发表于 2025-7-1 17:31
我看到的这个设计是通过寄存器调节系数,如果是开环调节,怎么检测眼宽然后自动调节系数?
...


没理解你这个说法。既然寄存器调节,就没有自动一说了。要不就是环路调节,那就是闭环了。
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 楼主| 发表于 2025-7-6 22:06:11 | 显示全部楼层


   
soulhenry 发表于 2025-7-6 18:02
没理解你这个说法。既然寄存器调节,就没有自动一说了。要不就是环路调节,那就是闭环了。
...


虽然是通过寄存器调节,可以根据信道衰减直接给个寄存器值,但是CPU也可以自动控制这个寄存器:


用一个检测方法,比如通过眼宽检测,判断开环DFE系数是不是合适,如果判断不合适CPU调节寄存器值,即DFE系数,这也可以实现调节自动化

我的问题是这个检测方法有哪些?


谢谢大佬!
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发表于 2025-7-7 15:16:20 | 显示全部楼层
那你这还是闭环啊,也叫自适应。可以通过硬件,也可以通过软件,都需要按照自适应算法来收敛。你自己查查相关的资料吧。
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发表于 2025-7-23 12:12:01 | 显示全部楼层
您好,想请问这里的 slicer 是由 pre-amp 加 latch 所组成的吗?比如是一个 sense amplifier 还是一个 sense amplifier + RS latch?再麻烦回复了,非常感谢您!
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发表于 2025-7-23 12:35:03 | 显示全部楼层


   
soulhenry 发表于 2025-7-7 15:16
那你这还是闭环啊,也叫自适应。可以通过硬件,也可以通过软件,都需要按照自适应算法来收敛。你自己查查相 ...


您好,想请问这里的 slicer 是由 pre-amp 加 latch 所组成的吗?比如是一个 sense amplifier 还是一个 sense amplifier + RS latch?再麻烦回复了,非常感谢您!

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发表于 2025-7-25 23:05:37 | 显示全部楼层
都可以,看你的运用了。
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 楼主| 发表于 2025-8-6 21:30:43 | 显示全部楼层
本帖最后由 xq19901211 于 2025-8-6 21:40 编辑


   
soulhenry 发表于 2025-6-30 14:41
其实也有slicer和dfe tap merge 在一起使用的,你这个结构也可以merge dfe的各个tap一起使用。
你这个如果 ...


大佬,
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 楼主| 发表于 2025-8-11 21:56:50 | 显示全部楼层
本帖最后由 xq19901211 于 2025-8-12 09:46 编辑


   
soulhenry 发表于 2025-6-30 14:41
其实也有slicer和dfe tap merge 在一起使用的,你这个结构也可以merge dfe的各个tap一起使用。
你这个如果 ...


大佬,再请教下,这种merged dfe是怎么更新抽头系数的?这种结构怎么建模?

也是这种电流镜像吗?DAC电流源的输出电流信号以电流镜的形式镜像到sampler加法器的抽头中,完成抽头系数的更新?



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发表于 2025-8-12 10:49:46 | 显示全部楼层
你需要给出一个具体的结构,我们可以讨论一下。不然对着空气说,也不太好理解。
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 楼主| 发表于 2025-8-12 11:23:42 | 显示全部楼层
本帖最后由 xq19901211 于 2025-8-13 10:33 编辑


   
soulhenry 发表于 2025-8-12 10:49
你需要给出一个具体的结构,我们可以讨论一下。不然对着空气说,也不太好理解。  ...


类似一开始的图片

电流积分型DFE,DAC产生vtp/vtn加在TAP_P和TAP_N上,差分结构
想请教下

1.这种结构的DFE是怎么更新抽头系数的?这种结构怎么建模?
国防科大有毕业论文是通过dac产生的vtp/vtn 差分幅值大小和vin幅值大小建模的

2.通过dac产生的vtp/vtn 共模电压大小有要求吗?和vin的共模一样才可以吗?

3.这种sampler 不止merge DFE tap,还有merge offset校准,offset校准方法是什么?有个通俗文档可以看看嘛


谢谢~







DFE.png
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