数字版图LVS过不了求帮忙看一下

dddddyx · 发表于 2025-2-8 13:22:04

使用v2lvs -v -o -s -s0 -s1生成的spi，在末尾也加了*.CONNECT VDD(VSS) VNW(VPW)

test2022 · 发表于 2025-2-8 13:22:39

点亮，版图不应接vss

Quinn714 · 发表于 2025-2-8 13:30:47

怀疑你可能有些floating gate没清完，或者tie hight、tie low没接完整，看报告和电源的连接倒是关系不那么大，只是电源的话其实还好处理的

dddddyx · 发表于 2025-2-8 13:31:23

test2022 发表于 2025-2-8 13:22
点亮，版图不应接vss

您好，我点开vss的错误，大多是这种，是不是spi里没有将VPW和VSS连上？

test2022 · 发表于 2025-2-8 13:47:50

参考2,4楼

dddddyx · 发表于 2025-2-8 14:08:14

Quinn714 发表于 2025-2-8 13:30
怀疑你可能有些floating gate没清完，或者tie hight、tie low没接完整，看报告和电源的连接倒是关系不那么 ...

您好，我看了一下innovus drc的报告，welltap和一些cell显示连接到了电源和地上。请问这个是不是tie high/tie low没连好？我在place后加的tie cell，显示只加了1个PULLHD0，后面我就没管了，是不是还需要再add一次？另外，我把保存的网表和sdf反标仿真了一下，仿真结果是对的，请问版图出现错误是可能是什么原因？希望您能不吝赐教。
屏幕截图 2025-02-08 135156.png

dddddyx · 发表于 2025-2-8 14:09:32

test2022 发表于 2025-2-8 13:47
参考2,4楼

请问我该怎么改呢？还是重新做一遍？

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