有大佬能帮忙看下这个fvf ldo的稳定性问题吗

夏至 · 发表于 3 天前

最近尝试复现下今年一篇jssc里面的ldo，但稳定性一直搞不好。在仿真这个快环的时候我是把slow loop断开，然后在M1 gate端加DC，然后从M2的gate端也就是VFA点加AC，那这一点也要加上对应的DC值吗？然后仿真出来的AC gain和phase曲线也比较奇怪，还请各位大佬给些指点

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夏至 · 发表于 3 天前

补一下电路图，不太清楚为什么这个环路gain会这么大，正常来说只有功率管和一个共栅级的gain

wandola · 发表于 3 天前

用stb仿真，不要做ac仿真。这是路延的论文吧？

夏至 · 发表于 3 天前

电路原理图

夏至 · 发表于 3 天前

这个是参考的paper

夏至 · 发表于 3 天前

wandola 发表于 2024-12-31 15:27
用stb仿真，不要做ac仿真。这是路延的论文吧？

用了stb，发现gain还是高的离谱，这个不是路老师的论文，是几个韩国人搞的

迷路大脸猫 · 发表于 3 天前

本帖最后由迷路大脸猫于 2024-12-31 17:11 编辑

负载电阻比较大时gain高正常。论文图14（a）不就挺大的。可以自行算算这个环路的零极点，就知道怎么改了。
应该是M1的本征增益做小一点，算一下gm1和RL的关系。

夏至 · 发表于 3 天前

迷路大脸猫发表于 2024-12-31 17:09
负载电阻比较大时gain高正常。论文图14（a）不就挺大的。可以自行算算这个环路的零极点，就知道怎么改了。
...

哦哦，您的意思是我单独仿这个快的loop，gain也应该是论文14b中的50-60dB这样吗，我以为仿快的loop应该只有十几dB左右；不过我满载10mA的情况下等效电阻负载也1200ohm

xdy609841687 · 发表于 3 天前

fvf的补偿方式本身就很难做，只适合给一些负载不太强的模块用，负载大了你的主极点和次极点之间会被压在一块

迷路大脸猫 · 发表于 3 天前

夏至发表于 2024-12-31 17:15
哦哦，您的意思是我单独仿这个快的loop，gain也应该是论文14b中的50-60dB这样吗，我以为仿快的loop应该只 ...

不对，论文中带着慢环跑，才会变成50dB。你这还要调。把gm1降低。

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