pll 开IBLEED电流后参考时钟沿与反馈的时钟沿的关系

高鹏 · 发表于 2024-8-15 16:26:14

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求问一下CP开IBLEED down端的电流后，小数分频锁定时，fdiv时钟在如图中所示的下面这个，而参考时钟沿是上面的这个，请问这个图是怎么仿真出来的，想仿真fdiv反馈的时钟沿一直在参考时钟沿的右侧分布情况，其实也是判断当前IBLEED电流是否足够将锁定相位移到线性区，如果fdiv时钟沿有在fdiv左侧的情况，说明当前的IBLEED down电流不够，但是这个文章中的图不知道怎么仿真出来的。

高鹏 · 发表于 2024-8-16 10:54:31

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[求助] pll 开IBLEED电流后参考时钟沿与反馈的时钟沿的关系

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